D触发器是一种基于基本RS触发器的电路,其工作原理与控制信号SD(预置)和RD(复位)的输入密切相关。当SD为低电平(SD非=1)且RD为高电平(RD非=0)时,无论D端的状态如何,触发器都会被置为0,Q端输出为1,Q非为0。反之,当SD为高电平(SD非=0)且RD为低电平(RD非=1),触发器将被置为1,Q端输出为0,Q非为1。SD和RD还可分别称为直接置1和置0端,它们通常需要接高电平以保证电路正常工作。
D触发器以边沿触发特性著称,它在CP信号的正跳沿前接收输入,在跳沿到来时进行状态切换,之后输入信号被封锁。与主从触发器相比,边沿触发器具有更强的抗干扰能力及更高的工作速度。其内部逻辑关系为Q等于D的非,CP信号则作用于G3和G4,要求在CP上升沿之前G5和G6的输出状态必须稳定。
当输入信号D端接收到信号时,需要经历一级门电路的延迟(tpd),D端的输入信号必须在CP上升沿之前到达。此外,D端信号建立时间需满足tset≥2tpd,以确保触发器的正确响应。这样,D触发器就能根据SD和RD的输入,以及CP信号的控制,灵活地进行状态切换。
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