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分析在74L S00电路测试实验中,为什么输入端悬 空,输出为低电平？
如题所述
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推荐答案 2020-03-09
74LS系列属于TTL电路，即是主要由
三极管
构成的电路。
在TTL逻辑门电路里，
与非门
的输入信号是直接连接到输入级的发射极上的，所以输入端悬空时，就是发射极悬空，这个这样会导致输入级三极管截止，其效果就是输出低电平。所以输入端悬空就相当于输入高电平。
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