verilog中a<=1'b1; b=1'b0; c<=1'b1; d=1'b1;的执行顺序先给a和b赋值,再给c和d赋值吗

如题所述

不对
a<=1'b1;和c<=1'b1;是同时执行的
b=1'b0;的执行

d=1'b1;的前面
a<=1'b1的b=1'b0谁先,确定不下来
结论:如果在结构说明语句里出现这样的赋值方式,是一个错误
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