求高手用三种方法设计异或门,用vhdl语言……只写结构体即可!

1、并发语句设计 2、process进程语句设计 3、if语句设计
只写结构体即可!本人急用……

第1个回答  2011-12-19
设计vhdl语言用哪个软件啊 常用的编译环境有Altera公司的Quartus和Xilinx公司的ISE两款软件。当然编译环境你可以选择notepad++或者Vi编辑工具。 基于追问

你理解错了,我不是要编译环境!而是要三种方法设计异或门的结构体!

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第2个回答  2011-12-19
设计vhdl语言用哪个软件啊 常用的编译环境有Altera公司的Quartus和Xilinx公司的ISE两款软件。当然编译环境你可以选择notepad++或者Vi编辑工具。 基于追问

你理解错了,我不是要编译环境!而是要三种方法设计异或门的结构体!

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